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J-GLOBAL ID:201302268620435527   整理番号:13A1116584

三次元変域ゲートイメージングにおける100ピコ秒水準タイミング制御系

Hundred ps level timing control system in 3D range-gated imaging
著者 (4件):
資料名:
巻: 41  号:ページ: 1792-1797  発行年: 2012年 
JST資料番号: C2521A  ISSN: 1007-2276  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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単純な制御関数の不利,単一構造,および従来のもの低い制御精度を克服するために,FPGAと遅延線に基づく,150ピコ秒精度の三次元変域ゲートされた制御系を設計した。FPGAの精度は10ナノ秒であった。一方,遅延線のそれは,150ピコ秒と同じくらいの精度だった。加えて,多重機能と高集積化,安定性と精度は,その利点であった。パソコンインタフェイスをプログラムした。更に,制御パラメータを自由に変えることができた。USB通信とシステムのあらゆるユニットの管理を,マイクロ制御ユニット(MCU)によって実行した。また,150ピコ秒の精度を持つFPGAと遅延線により発生する,ナノ秒精度のタイミング信号を用いた。多くの新しい機能,たとえば,ゲートされた増圧器のMCP利得制御,パルスレーザ出力制御と,制御パラメータのLCDリアルタイム表示を加えた。実験室の試験とシステム実験は両方とも,三次元制御系の設計が正しいことを示した。USBは正しく通信し,タイミング信号を発生させることができた。更に,MCP利得とレーザ出力の管理は良好に働いた。最後に,それは三次元変域ゲートされたイメージングにおいて,安定して動作することができた。Data from the ScienceChina, LCAS. Translated by JST
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分類 (1件):
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図形・画像処理一般 
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