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J-GLOBAL ID：201602000166640021 整理番号：65A0164467
3個のトランジスタによる3安定回路
Threetransistor ternary latch
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著者 (1件)：
TRAMPEL K M
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資料名：
IBM Tech Disclosure Bull (IBM Technical Disclosure Bulletin)
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巻：
7
号：
6
ページ：
542-543
発行年：
1964年
JST資料番号：
E0292B
ISSN：
0018-8689
CODEN：
IBMTA
資料種別：
逐次刊行物 (A)
記事区分：
解説
発行国：
アメリカ合衆国 (USA)
抄録/ポイント：
抄録/ポイント
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C,Rおよびダイオードで結合された3個のトランジスタが入力パルスに応答して頌次に選択的に導通する回路。出力波形は階段状である;図1
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