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J-GLOBAL ID：201602000626221901   整理番号：71A0247667

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著者 (1件)：
HANNON J T Jr

HANNON J T Jr について


資料名：
Electron Eng  (Electronic Industries)

Electron Eng について


巻： 30  号： 3  ページ： 54  発行年： 1971年 
JST資料番号： B0501A  資料種別： 逐次刊行物 (A)
記事区分： 解説  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)
抄録/ポイント：
抄録/ポイント
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読出し回路において.付加ハードウエアが最小で6および9の双方の数字に対してflagをつけ加えられる回路を紹介した。通常の読出し回路が7分割形成で,これらの表示回路にデコーダおよび駆動回路を付加した場合に.これらのインターフェイス回路がflagなしの6または9の数字を発生するのと対照的である。この回路は2個のNORゲートをインバータとして使用し,7分割デコーダSN7448を含む回路図を示した;写図1
シソーラス用語：
シソーラス用語/準シソーラス用語
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