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J-GLOBAL ID:201602249841057236   整理番号:16A1366755

12~24GHzの高効率,完全集積化0.18umCMOSパワーアンプ

A 12 to 24 GHz high efficiency fully integrated 0.18 μm CMOS power amplifier
著者 (6件):
資料名:
巻: 13  号: 14  ページ: 20160551(J-STAGE)  発行年: 2016年 
JST資料番号: U0039A  ISSN: 1349-2543  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 英語 (EN)
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本論文では,準ミリ波応用のための高効率で群遅延変動の小さい12~24GHz完全集積化CMOSパワー・アンプ(PA)を提案した。オンチップの入力,出力,ステージ間の整合回路の最適化により,電力付加効率(PAE)を最大化し,広帯域周波数範囲での群遅延変動を最小化した。また,スタガ同調を採用して優れた利得平坦性を実現した。提案手法を用いて2段CMOS PAを設計し,0.18umCMOS技術で製作し,試験した。測定により,10.5±0.7dBの電力利得S21と,解析周波数範囲で±20psの小さな群遅延変動を達成した。そのPAは,DC消費電力50mWで最大PAE26%の測定値を示した。(翻訳著者抄録)
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分類 (2件):
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半導体集積回路  ,  増幅回路 
引用文献 (12件):
  • [1] K.-A. Hsiehet al.: “A dual-band 10/24-GHz amplifier design incorporating dual-frequency complex load matching,” IEEE Trans. Microw. Theory Techn. 60 (2012) 1649 (DOI: 10.1109/TMTT.2012.2191303).
  • [2] W.-H. Hung, et al.: “An 18dBm transmitter frontend with 29% PAE for 24GHz FMCW radar applications,” 2012 IEEE Radio Frequency Integrated Circuits Symposium (RFIC) (2012) 137 (DOI: 10.1109/RFIC.2012.6242249).
  • [3] C.-Y. Wu, et al.: “A 24-GHz CMOS current-mode PA with high PAE and output power,” IEEE International Symposium on Circuits and Systems (ISCAS 2007) (2007) 2866 (DOI: 10.1109/ISCAS.2007.378770).
  • [4] J.-L. Kuo and H. Wang: “A 24 GHz CMOS power amplifier using reversed body bias technique to improve linearity and power added efficiency,” IEEE Int. Microwave Symp. Dig. (2012) 1 (DOI: 10.1109/MWSYM.2012.6258363).
  • [5] N.-C. Kuo, et al.: “K-band CMOS power amplifier with adaptive bias for enhancement in back-off efficiency,” IEEE Int. Microwave Symp. Dig. (2011) 1 (DOI: 10.1109/MWSYM.2011.5972589).
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