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J-GLOBAL ID:201602275333870076   整理番号:16A1089748

CPUとFPGAの混在回路を用いた障害物検知ロボットの作成~障害物検知を目的としたアルゴリズム開発~

著者 (2件):
資料名:
巻: 2016  ページ: ROMBUNNO.Po1-12  発行年: 2016年09月01日 
JST資料番号: L1634B  資料種別: 会議録 (C)
記事区分: 短報  発行国: 日本 (JPN)  言語: 日本語 (JA)
シソーラス用語:
シソーラス用語/準シソーラス用語
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分類 (2件):
分類
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ロボットの設計・製造・構造要素  ,  人工知能 

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