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J-GLOBAL ID:201602286027589627   整理番号:16A1152727

マルチコアCPU上のGbpsターボ復号器を超えて【Powered by NICT】

Beyond Gbps Turbo decoder on multi-core CPUs
著者 (6件):
資料名:
巻: 2016  号: ISTC  ページ: 136-140  発行年: 2016年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
抄録/ポイント:
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携帯ソフトウェアターボ復号器の高スループット実装を提示した。コードは従来のマルチコアCPU(x86)のために最適化され,強化されたmax-log-MAPターボ符号復号変異体に基づいている。コードはLTE-Advanced仕様に従った。高性能の鍵は固定小数点表現と組み合わせたフレーム間SIMD戦略に由来する。著者らの結果は,ターボ復号器の提案したマルチコアCPU実装はスループットとエネルギー効率の観点からGPU実装に挑戦的な代替法であることを示した。ハイエンドプロセッサについて,著者らのソフトウェアターボ復号器はK<4096のすべてのレート1/3LTE符号のための1Gbps情報スループットを超えていた。Copyright 2016 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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符号理論 
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