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J-GLOBAL ID:201702211186994494   整理番号:17A1778991

再構成可能アーキテクチャを用いた演算増幅器の高速BiJFet【Powered by NICT】

The high-speed BiJFet of Op-Amps with reconfigurable architecture
著者 (4件):
資料名:
巻: 2017  号: EWDTS  ページ: 1-4  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
抄録/ポイント:
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演算増幅器のBiJFetの新しいアーキテクチャを提案し,入力(DS)および中間(DP)段階の非線形操作条件を除去し,大信号動作して作用する場合に。DSとして,異なる作用原理とBiJとBiJFトランジスタ上のクラス「AB」のスキームを用いた。BiJT「折畳み」カスコードに及ぼす中間DPにおいてシグナル伝達チャンネルの自動スイッチングはDS出力電流の数値に依存して提供した。これは非線形DPモードを除去することにより演算増幅器の平衡コンデンサを充電の過程を骨材では,新しい回路解はオフセット電圧の系統的成分(Voff<1.5μν,Fn<10~18n/m~2T=83°K~303°Kまで中性子束まで)の高放射と低温安定性で2500~2800V/μsのレベルで約100MHz単一利得周波数の演算増幅器のBiJFetの最大スルーレートを提供する。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (1件):
分類
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増幅回路 
タイトルに関連する用語 (2件):
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