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J-GLOBAL ID:201702213974430992   整理番号:17A2003391

実施目標を最適化するための合成旗の調整:事例研究としてのLEON3プロセッサの性能とロバスト性【Powered by NICT】

Tuning synthesis flags to optimize implementation goals: Performance and robustness of the LEON3 processor as a case study
著者 (3件):
資料名:
巻: 112  号: P1  ページ: 84-96  発行年: 2018年 
JST資料番号: D0613B  ISSN: 0743-7315  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: オランダ (NLD)  言語: 英語 (EN)
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FPGAの複雑さにおける定常成長はそれらの実施目標を達成するために設計者が製造者と第三者の設計ツールにますます依存をもたらした。しかし,現代合成ツールは無数の異なる最適化フラグの実施目標に向けてその寄与は明確に説明されないを提供するので,設計者は丁度のそれらの旗の少数を利用した。本論文では,設計者の実施目標を最適化するために利用可能な合成フラグの最良の構成を決定する挑戦的な問題を扱った。最初に,全体設計空間を減少させるのに用いられる一部実施要因設計。得られた配置は,検討した各合成旗の,統計的有意性,実際の影響を評価するために実行した。後,多重回帰分析技術がこれらの旗の可能な組み合わせのための期待される成果を予測した。最後に,多基準意思決定技法を明示的に定義された実施目標に従って合成フラグの最適配置の選定を可能にする。Copyright 2018 Elsevier B.V., Amsterdam. All rights reserved. Translated from English into Japanese by JST.【Powered by NICT】
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分類 (1件):
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ディジタル計算機方式一般 

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