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J-GLOBAL ID:201702216589967649   整理番号:17A1359861

性能,電力および面積スケーリングのための可能な共同開発10nm高性能モバイルSoC設計と技術【Powered by NICT】

10nm high performance mobile SoC design and technology co-developed for performance, power, and area scaling
著者 (27件):
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巻: 2017  号: VLSI Technology  ページ: T70-T71  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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産業の最初の10nm低電力高性能モバイルSoCは,生産における傾斜することに成功した。徹底した設計技術共同開発のおかげで,10nm SoCは,その14nmのものよりも16%速く,37%小さく,30%低い電力である。最新SoCは,ギガビットクラスモデムを特徴とし,AR/VR,AJ,機械学習,と計算を前進させるために設定した。急激に増加し配線抵抗と変動と強いレイアウト応力効果のような10nm FinFet技術スケーリングの挑戦は,製品ランプ段階スケーリングエンタイトルメントを実現するために必須である技術定義から設計と技術共同開発を説明するために考察した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (1件):
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人工知能 

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