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J-GLOBAL ID：201702217573651580   整理番号：17A1358470

新しいスケーラブル電流再利用フロントエンドを持つ完全に移植可能なマルチチップ神経インタフェイス【Powered by NICT】

A fully implantable multichip neural interface with a new scalable current-reuse front-end

著者 (5件)： Rezaei M. (Dept. of Electrical and Computer Eng., Universite ́ Laval, Quebec, G1V 0A6, Canada) ,  Maghsoudloo E. (Dept. of Electrical and Computer Eng., Universite ́ Laval, Quebec, G1V 0A6, Canada) ,  Bories C. (Research Center of the Quebec Mental Health Institute, Universite ́ Laval, G1J 2G3, Canada) ,  De Koninck Y. (Research Center of the Quebec Mental Health Institute, Universite ́ Laval, G1J 2G3, Canada) ,  Gosselin B. (Dept. of Electrical and Computer Eng., Universite ́ Laval, Quebec, G1V 0A6, Canada)
資料名： IEEE Conference Proceedings  (IEEE Conference Proceedings)
巻： 2017  号： NEWCAS  ページ： 365-368  発行年： 2017年 
JST資料番号： W2441A  資料種別： 会議録 (C)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)

抄録/ポイント： 本論文では,低電力多チャネル電流再利用アナログフロントエンド(AFE),マルチバンド無線送受信機と新しい5コイル誘導リンクを通して13.56MHzキャリアからの電力を検索する電力管理ユニットを含む新しいCMOSシステムオンチップ(SOC)に基づく完全に移植可能なブレインマシンインタフェイスを提案した。このSOCに加えて,提案した界面は,低電力マイクロコントローラ,広帯域アンテナと両面動力回収コイルを含んでいる。全成分は,薄いフレキシブルプリント回路基板に結合していた。AFEは非常に多数の記録チャネルへの拡張が可能で,カレントミラー演算増幅器に基づく新しい電流再利用回路トポロジーを使用し,小さい実装面積と低電力消費のためである。低雑音増幅器(LNA)と35dB,43.1dBおよび49.5dBの樹木選択利得を呈したプログラマブル利得増幅器(PGA)を含んでいる。SOC CMOS180nmプロセスで製作し,1.3mm×1.8mmの寸法を持つ。AFEは,チャネル当たり9μW(LNAのための4.5μw及び4.5μw PGA)の低消費電力を有し,3.2μVの入力関連雑音。効率28%,1cm~2フレキシブルコイルを通じて81mWの負荷に供給される最大電力で利用されている5コイル無線電力リンク。超広帯域エッジ結合BPSK送信機は,6.7pJ/ビットで800Mbpsの最大データ速度に達し,2.4GHz OOK受信機は100Mbpsの最大データ速度に達した。システム全体は12.3mWと重量0.163gを消費した。最後に,麻酔マウスの皮質からin vivoで得られた生物学的結果を提示した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】

シソーラス用語： 低雑音増幅器 ,  マイクロコントローラ ,  利得 ,  演算増幅器 ,  受信機 ,  フレキシブル基板 ,  *電力 ,  送信機 ,  雑音 ,  チャネル ,  電力管理
準シソーラス用語： データレート ,  システムオンチップ ,  低電力化 ,  *電流再利用 , 【Automatic Indexing@JST】

分類 (1件)： 半導体集積回路  (NC03162T)

タイトルに関連する用語 (5件)： 電流再利用 ,  フロントエンド ,  移植 ,  マルチ ,  神経インタフェイス