抄録/ポイント:
抄録/ポイント
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現代の集積回路の複雑さを考えると,設計再利用が必須であるが,現在のハードウェア記述言語は多くのクラス設計の再利用の課題を適切に行っていない。,例として,プロセッサコア,サイクルレベル相互作用により形成されると,異なるタイミング制約のある環境へのそのような設計を利用するリタイミング,repipelining,と微細構造変化を必要とする。レジスタ転送レベルでのこれらの変化を作る重要な書き換えが必要である。抽象化が必要であるが,SystemCとOpenCLの抽象化は疎結合微細構造相互作用に適している。挙動とタイミングの問題を分離することを提示したタイミング抽象モデリングアプローチ。タイミング抽象挙動はパイプラインの文脈の中で特定し,パイプライン内の論理は,実装詳細のパイプラインステージに帰属した。逐次要素はパイプライン化された仕様からのツールにより生成した。論理は容易にretimed,機能的バグを導入することのリスクなしにできるので,設計と検証努力が異なるタイミング制約のある状況に設計を再標的化するのに必要な行動変化に着目する。二次利点として,有意に少ないソースコードは,レジスタ転送レベル詳細を指定する必要がある。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】