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J-GLOBAL ID:201702241879995649   整理番号:17A1400263

DD L1D:GPUアーキテクチャのための分離L1D効率の改善【Powered by NICT】

DD-L1D: Improving the Decoupled L1D Efficiency for GPU Architecture
著者 (5件):
資料名:
巻: 2017  号: NAS  ページ: 1-10  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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大量コンカレントスレッドによる,GPU L1データキャッシュ競合は不十分なキャッシュ利用と性能低下をもたらし,特にキャッシュ優しくない応用。キャッシュバイパスは,この問題を軽減するために広く使用されている方法であり,分離L1D(D L1D)は予防バイパス方式,メモリアクセスストリームのデータ局所性を考慮することによりキャッシュ優しくないアプリケーションのための性能改善を実現している。しかし,実験及び分析は,D L1Dによる限られた性能利得は事前に定義された局所性しきい値に起因して達成されることを示した。この問題に取り組むために,筆者らは,動作中に局所性しきい値を動的に更新することにより少ない競合にL1データキャッシュを指示する動的D L1D(DD L1D)と命名した新規バイパス方式を提案した。L1キャッシュバイパス状態を示し,最終的な構成におけるバイパスミス率を選択するDD L1Dにおける四つの計量を評価した。実験結果はDD L1Dはキャッシュ優しくないベンチマークに対して平均1.45Xによるベースライン性能を改善することを示す。も低いハードウェアオーバヘッドとメモリトラフィックを持つD L1D,最新GPUキャッシュバイパス方式より性能が優れている。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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