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J-GLOBAL ID:201702269012407359   整理番号:17A1037284

クリティカリティ混在ネットワークオンチップのための効率的なレイテンシの保証【Powered by NICT】

Efficient Latency Guarantees for Mixed-Criticality Networks-on-Chip
著者 (2件):
資料名:
巻: 2017  号: RTAS  ページ: 113-122  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
抄録/ポイント:
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将来mixedcriticalityシステムのための抽象ネットワークオンチップ(NoC)は,成長する多様なトラヒック要求のバースト敏感なベストエフォート型トラヒックへの安全性が重要な実時間トラヒックを扱う必要がある。さらに,安全基準(例えばISO-26262)は最高の適用可能な安全レベルに応じて異なる臨界レベルまたは全システム認証間の十分な独立性を必要とする。NoCは,安全交通の性能分離を提供しなければならないが,ベストエフォート型トラヒックのための低待ち時間を維持する。本論文では,ベストエフォートトラヒックの性能に及ぼす減少した悪影響せの安全性重視トラヒックのための遅延保証を可能にする実行時構成可能NoC設計を提示した。既存アプローチとは対照的に,安全交通上のベストエフォートと必要なときのみスイッチ優先順位を占めた。を行なうために,筆者らは,セーフティクリティカル用途の潜時スラックを利用して,一方,異なる臨界レベルタイミング特性に関して間の十分な独立性を提供した。形式的解析および実験的評価,アプローチは安全性が重要なアプリケーションのための性能分離をすることを示す,ベストエフォート応用に厳密な優先化により悪影響を低減しながらCopyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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電話・データ通信・交換一般  ,  計算機網 
タイトルに関連する用語 (3件):
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