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J-GLOBAL ID:201702271505485007   整理番号:17A1633723

OFDM受信機の設計と試験による不均一マルチコアアーキテクチャの評価【Powered by NICT】

Evaluation of a Heterogeneous Multicore Architecture by Design and Test of an OFDM Receiver
著者 (3件):
資料名:
巻: 28  号: 11  ページ: 3171-3187  発行年: 2017年 
JST資料番号: T0882A  ISSN: 1045-9219  CODEN: ITDSEO  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,機能性の試験のための設計としての直交周波数分割多重化(OFDM)受信機ブロックを実行することにより不均一マルチコアアーキテクチャ(HMA)の評価を提示した。OFDM受信機は超並列だけでなく,HMAのような汎用プラットフォームを試験し評価する最大被覆率を提供できることを計算的に集約的で汎用処理タスクから構成されている。受信機のブロックは主にテンプレートベース粗粒度再構成可能アレイ(CGRA)デバイスを作成し,ネットワークオンチップ(NoC)構造と共に完全なOFDM処理のためのいくつかのRISCコア上で連続してそれらを整理して設計した。高速Fourier変換(FFT)と時間同期のようなOFDMブロックは計算量が多く,並列処理を必要とする。OFDM受信機も,自然界で連続ことをTaylor級数およびCORDICアルゴリズムの処理を必要とする周波数オフセット推定のようなタスクを含んでいた。直列及び並列アルゴリズムのこのような組合せは,HMAのほぼ全ての設計特徴の徹底的な調査と評価を行うことができる。OFDM実装には,別の次元にCGRAをスケール,多重演算資源としての処理要素(PE)を具体化し,PE相互接続の可能な方法ほとんどすべてを規定することをもたらした。CGRAメモリにおけるデータ配置のための時間多重化パターンを調べた。それにもかかわらず,データは直接メモリアクセスデバイスを用いたNoC構造上異なるノード間で交換される同時にかつ独立にできる。本実験研究では,各CGRAの性能,全プラットフォームの集団性能とNoC交通はクロックサイクルといくつかの高水準性能測定基準の数の点で記録した。今日のHMAは一般的にあるいはそれらは,エンドユーザのための最適選択ないための設計された応用のための資源。その他の最先端技術との興味ある比較とは別に,著者らの実験装置は,重要な洞察と設計者はそれらの標的への応用のための準最適解を実現するために使用できる指針を提供した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (1件):
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ディジタル計算機方式一般 

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