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J-GLOBAL ID:201702271580115408   整理番号:17A1254831

Xilinx UltraScaleメモリカスケードを用いたFPGAオーバレイNoC(ネットワークオンチップ)の実装【Powered by NICT】

Implementing FPGA Overlay NoCs Using the Xilinx UltraScale Memory Cascades
著者 (1件):
資料名:
巻: 2017  号: FCCM  ページ: 40-47  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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Xilinx UltraScale BlockRAMsをカスケードfeatureofを利用して偏向経路FPGAオーバレイNoCの性能と効率を向上させることができる。これは(1)NoCスイッチクロスバーにおけるhardentheマルチプレクサ,と(2)偏向ルーティングにefficientlyadd緩衝支援することを可能にする。緩衝は偏向ルーティングNoCの正しい動作に必要ではないが,大きな系サイズunderheavy負荷のためのネットワークスループットを高め,固定長,マルチフリットNoC交通に対する機能的支援を可能にする。cascadedRAMsのマルチプレクサ制御はユーザ論理から得ることができるので,NoCルーティングはLUTに実装することがfunctioncanデータはacrossthe専用カスケードマルチプレクサとリンク走査が可能である。クロスバ多重化だけでなく,パケット待ち行列の形でNoCのコストのthebulkを吸収するブロックRAMアーキテクチャにおけるapproachuses硬資源。XCVU9P UltraScale+FPGAでは,727MHz(60×12グリッドにおける400MHz)で動作する一方スイッチ当たり3fifoブロック,64LUT,および40FFのコストで72b Hoplite NoCルータを地図化する方法を示した。これはLUT数by1 4×とFFコストを2×による純LUT implementationwhileも1.2×速い。均一ランダムトラヒックに対して,16×16のweboostスループットは50~60%NoC,最悪の場合のパケット待ち時間を減少させる40%,16深いバッファを持つ15~20%以上の注入速度で古典的バッファ偏向ルーティングで10~40%のエネルギー使用を低下させる。hardNoCルータ設計と比較した場合,著者らのBRAMベースソフトNoCも以前の研究で20~23×gapclaimedの代わりに二倍以下にtheareaギャップを閉じた。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (5件):
分類
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半導体集積回路  ,  論理回路  ,  専用演算制御装置  ,  集積回路一般  ,  ディジタルフィルタ 

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