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J-GLOBAL ID:201702275540711853   整理番号:17A1318129

広帯域低電力低雑音増幅器の回路設計について述べた。【JST・京大機械翻訳】

Design of a broadband low-power and low-noise amplifier
著者 (5件):
資料名:
巻: 22  号:ページ: 69-72,76  発行年: 2017年 
JST資料番号: C3644A  ISSN: 1007-3264  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
抄録/ポイント:
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TSMC 0.18μm CMOSプロセスを用いて,低電力消費容量交差結合低雑音増幅器を設計した。静電容量交差結合構造を用いて,電力損失なしに回路の有効な相互コンダクタンスを向上させ,広帯域増強技術を用いて,回路の零点位置を効果的に変化させ,回路の動作帯域幅を拡大した。シミュレーション結果により,低雑音増幅器の動作帯域幅は6.8GHz,回路雑音指数は2.8dB,電力消費は5.35mWで,LNA回路の性能要求を満たすことを示した。Data from Wanfang. Translated by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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増幅回路  ,  半導体集積回路 
タイトルに関連する用語 (4件):
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