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J-GLOBAL ID:201702276801425480   整理番号:17A0757209

多段BCH復号器のための並列復号化【Powered by NICT】

Parallel decoding for multi-stage BCH decoder
著者 (5件):
資料名:
巻: 2016  号: ISOCC  ページ: 107-108  発行年: 2016年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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マルチプロセッサ(CPU/GPUのような)と大量シリコン貫通ビア(TSV)の垂直相互接続DRAMダイスを統合した3D不均一プロセッサ(一般的に3DHPと呼ぶ)は,オフチップDRAMの制限された帯域幅,高待ち時間とエネルギー消費に対処するために期待されている。しかし,オンチップ熱勾配におけるホットスポットに起因する空間的および時間的変動をDRAMダイスにおける広いビット誤り率変化をもたらす可能性がある。マルチパスBCH復号器はこの問題に取り組む効率的に提案された。本論文では,多段BCH復号器のための新しい並列復号化アプローチを提案し,検証した。提案されたアプローチは,効率的に複数の単語を解読するために多重復号化経路を利用すると,全体としての復号化待ち時間を最小化する。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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