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J-GLOBAL ID:201702278361291313   整理番号:17A1025617

MOFPSOに基づくHVDCの直流バイアス電流抑制抵抗器の最適配置【Powered by NICT】

Optimized configuration of DC bias current suppression resistors in HVDC based on MOFPSO
著者 (3件):
資料名:
巻: 2017  号: APEC 2017  ページ: 1027-1032  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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HVDC系統の単極動作を変圧器のDCバイアス電流を引き起こし,DCバイアス電流は電力系統の安全性と安定性の問題をもたらす。変圧器の中性点に電流抑制抵抗器を結ぶDCバイアス電流を制限する有効な方法である。しかし,電流抑制抵抗器は零相電流保護の感度を減少させた。このように,本論文では,最適化された配置すなわち全電流抑制抵抗と同様にDCバイアス電流を最小化するための多目的ファジィパーティクルスワーム最適化(MOFPSO)アルゴリズムを提案した。最後に,有効性とアルゴリズムの実現可能性は,中国Ximeng Taizhou±800kV高電圧直流システムを用いて証明した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (1件):
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電力系統一般 
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