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J-GLOBAL ID:201702282585610736   整理番号:17A1358437

低電力無線受信機応用のためのCMOSエンベロープ検出器の設計考察【Powered by NICT】

Design considerations of a CMOS envelope detector for low power wireless receiver applications
著者 (2件):
資料名:
巻: 2017  号: NEWCAS  ページ: 233-236  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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以前の研究では,トランジスタの相互コンダクタンスとドレイン電流比はアナログ回路を最適化するために有用であることを示した。本論文では,包絡線検波器の出力で発生した第二次歪を捕捉する表式を導出した。誘導発現,0.13μm CMOSプロセスで3μA包絡線検出器を設計するための非線形Taylor級数係数を用いた。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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分類 (2件):
分類
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トランジスタ  ,  集積回路一般 

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