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J-GLOBAL ID:201702287625751477   整理番号:17A1570130

高レベル合成のためのメモリfartitioningベースモジュロスケジューリング【Powered by NICT】

Memory fartitioning-based modulo scheduling for high-level synthesis
著者 (6件):
資料名:
巻: 2017  号: ISCAS  ページ: 1-4  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
抄録/ポイント:
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高位合成(HLS)はアルゴリズム評価と製品プロトタイピングのためのFPGAを標的とする効率的な編集プロセスとして広く認識されている。しかし,メモリアクセス要求超並列とマルチポートを持つ単一バンク記憶の非常に高価なコストは妨害されたループパイプライン性能を示した。代替マルチバンク・メモリアーキテクチャに基づく,メモリを意識したforce directedスケジューリングと多サイクルメモリ分割を用いた共同アプローチは形式的に少ない資源消費と最適パイプライン性能と正当なパイプラインカーネルと有効バンクマッピングを達成するために提案する。種々のベンチマーク上での実験結果により,提案アプローチでは,最適パイプライン性能を達成し,一方平均の複数の独立したメモリバンク数を55.1%減少させ,最先端の手法と比較できることを示した。Copyright 2017 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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CAD,CAM  ,  半導体集積回路 
タイトルに関連する用語 (1件):
タイトルに関連する用語
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