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J-GLOBAL ID:201702292094903339   整理番号:17A0545313

ストライドアクセスの階層構造に着目したフェーズ検出

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巻: 116  号: 511(DC2016 84-108)  ページ: 9-14  発行年: 2017年03月02日 
JST資料番号: S0532B  ISSN: 0913-5685  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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プログラム実行は異なる傾向を持つ複数の「フェーズ」に分割できることが知られている。フェーズ検出はシミュレーションポイントの検出からマイクロアーキテクチャの適応制御まで,静的・動的双方の面でプロセッサの効率化に有用である。しかしながら,キャッシュの解析や適応制御においては,他の解析において広く用いられてきたフェーズ検出手法は精度が不十分であり,活用が進んでこなかった。本論文ではメモリの大域的なアクセスパターンを基にフェーズ検出を行う手法を提案し,フェーズ検出をキャッシュ最適化用途に利用可能なことを明らかにする。提案手法および従来手法についてキャッシュヒット率が変化する箇所の検出精度を比較したところ,スレットスコアにおいて従来手法よりも平均0.20,最大0.87高いスコアが得られ,提案手法の有効性が示された。(著者抄録)
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