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J-GLOBAL ID:201802222068156877   整理番号:18A1258716

レールツーレール2段CMOS演算増幅器:比較解析【JST・京大機械翻訳】

Rail-to-rail two stage CMOS operational amplifier: A comparative analysis
著者 (3件):
資料名:
巻: 2018  号: ICISC  ページ: 152-160  発行年: 2018年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文は,種々の低電圧CMOS演算増幅器を提示した。閾値低減技術は,供給電圧を減少させるためにバルク駆動方式の利用によって予見される。バルク駆動アプローチにより同定された欠点を述べ,それらを強化するための戦略を提案した。Op-Ampの相互コンダクタンスを増加させるために,カスコード入力ステージと交差結合出力ステージを,面積の拡大なしに利用し,バルク駆動のMOSFETを部分正フィードバックに沿って利用することができる。これらの方法はdc利得の増加を助ける。供給電圧スケーリングは,利得増加,効率的電力利用があり,オンチップが減少するので,中心的要因であった。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (1件):
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増幅回路 
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