文献
J-GLOBAL ID：201802222776777366
整理番号：18A2018492
断熱的論理による暗号回路への相関電力解析攻撃による評価
Evaluation of Power Analysis Attacks on Cryptographic Circuit Using Adiabatic Logic
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著者 (2件)：
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資料名：
号：
ECT-18-061-081.083 電子回路研究会
ページ：
1-4
発行年：
2018年10月11日
JST資料番号：
Z0924B
資料種別：
会議録 (C)
記事区分：
原著論文
発行国：
日本 (JPN)
言語：
日本語 (JA)
シソーラス用語：
シソーラス用語/準シソーラス用語
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分類 (3件)：
分類
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符号理論
, データ保護
, 論理回路
引用文献 (8件)：
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C. Monteiro, Y. Takahashi, and T. Sekine, ′′Charge-sharing symmetric adiabatic logic in countermeasure against power analysis attacks at cell level,′′ Microelectronics J., vol. 44, no. 6, pp. 496-503, June 2013.
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M. Avital, H. Dangan, I. Levi, O. Keren, and A. Fish, ′′DPA-secured quasi-adiabatic logic (SQAL) for low-power passive RFID tags wmploying S-boxes,′′ IEEE Circuit and Syst. -I, vol. 62, no. 1, pp. 149-156, Jan. 2015.
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S.D. Kumar, H. Thapliyal, A. Mohammad, and K.S. Perumalla, ′′Design exploration of a symmetric pass gate adiabatic logic for energy-efficient and secure hardware,′′ Integr. VLSI J., vol. 58, pp. 369-377, June 2017.
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K. Tiri, M. Akmal, I. Verbauwhede, ′′A dynamic and differential CMOS logic with signal independent power consumption to withstand differential power,′′ in Proc. European Solid-State Circuit Conf., ESSCIRC 2002, Florence, Italy, Sept. 24-26, 2002, pp.403-406.
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M. Bucci, L. Giancane, R. Luzzi, and A. Trifiletti, ′′Three-Phase dual-rail precharge logic,′′ in Proc. Cryptographic Hardware and Embedded Systems, CHES 2006, Yokohama, Japan, Oct. 10-13, 2006, pp. 232-241.
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