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J-GLOBAL ID：201802224388339018   整理番号：18A0564231

TCI結合されたSOTBを用いたプロセッサのためのZynqを用いた評価環境の構築

著者 (5件)： 大城研治 (東京農工大) ,  小柴篤史 (東京農工大) ,  濱田慎亮 (東京農工大) ,  天野英晴 (慶応大) ,  並木美太郎 (東京農工大)
資料名： 情報処理学会全国大会講演論文集
巻： 80th  号： 1  ページ： 1.93-1.94  発行年： 2018年03月13日 
JST資料番号： S0731A  資料種別： 会議録 (C)
記事区分： 短報  発行国： 日本 (JPN)  言語： 日本語 (JA)

シソーラス用語： 層 ,  半導体チップ ,  インタフェイス ,  演算プロセッサ ,  計算機システム ,  *評価 ,  *環境 ,  消費電力 ,  バイアス ,  周波数制御 ,  *半導体プロセス ,  積層 ,  プラットフォーム【計算機】 ,  *省エネルギー技術 ,  *節約
準シソーラス用語： *省エネルギー ,  チップ【IC】 ,  プロセッサ ,  ボディバイアス ,  *省電力化

分類 (2件)： 半導体集積回路  (NC03162T) ,  専用演算制御装置  (JC04030Y)

引用文献 (2件)：

• K. Masuyama et al., ′′A 297MOPS/0.4mW Ultra Low Power Coarse-grained Reconfigurable Accelerator CMA-SOTB-2′′, 2015 International Conference on ReConFigurable Computing and FPGAs, 2016
• H. Okuhara et al., ′′An optimal power supply and body bias voltage for a ultra low power micro-controller with silicon on thin box MOSFET′′, Low Power Electronics and Design (ISLPED), 2015 IEEE/ACM International Symposium on, 2015

タイトルに関連する用語 (5件)： TCI ,  プロセッサ ,  評価 ,  環境 ,  構築