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J-GLOBAL ID:201802232619811587   整理番号:18A2035958

アジャイルおよびFPGAベースの同時3帯域全ディジタルRF伝送のための実時間アーキテクチャ【JST・京大機械翻訳】

A Real-Time Architecture for Agile and FPGA-Based Concurrent Triple-Band All-Digital RF Transmission
著者 (8件):
資料名:
巻: 66  号: 11  ページ: 4955-4966  発行年: 2018年 
JST資料番号: C0229A  ISSN: 0018-9480  CODEN: IETMAB  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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隣接/非連続キャリア凝集(CA)は4Gシステムからの重要な特徴の一つであり,5G技術内で進化すると期待される。したがって,複数のバンドと複数の標準の統合のための自然のサポートを有する柔軟で,アジャイルで,再構成可能な無線送受信機の開発の必要性がある。全ディジタル高周波(RF)送信機は次世代RFトランシーバの設計に有望な可能性を示した。しかしながら,同時マルチバンド伝送は,現在のアプローチの重要な限界の1つである。この問題を解決するために,本論文では,アジャイルの実時間設計と同時三重帯域伝送を可能にする完全ディジタルおよび並列アーキテクチャを提案した。提案したアーキテクチャは,隣接および非連続CAシナリオの両方に適しており,周波数アジリティ,帯域間の最大間隔,および凝集帯域幅に関して,最先端の状態を大幅に上回る。システム性能を強化するために,パルス波形のアナログ組合せに基づくマルチレベルアーキテクチャへの拡張も実証した。両アーキテクチャ(2と7レベル)をフィールドプログラマブルゲートアレイに実装した。信号対雑音比,誤差ベクトルの大きさ,および隣接チャネル電力比に関する測定結果を示し,議論した。インピーダンス-Iにおいて,2レベルアーキテクチャは,56.26MHzの凝集帯域幅を有する0.1~2.5GHz(周波数分解能4.88MHz)の周波数アジリティを示した。インピーダンスIIにおいて,7レベル設計は,112.5MHzの凝集帯域幅をもつ0.1から2GHz(周波数分解能3.906MHz)の周波数アジリティを示した。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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