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J-GLOBAL ID:201802234693994481   整理番号:18A1156410

アレイプロセッサに基づくデブロッキングフィルタアルゴリズムの並列化設計【JST・京大機械翻訳】

A paralleling design for deblocking filtering algorithm based on array processor
著者 (3件):
資料名:
巻: 22  号:ページ: 67-72  発行年: 2017年 
JST資料番号: C3644A  ISSN: 1007-3264  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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多視点ビデオ符号化におけるデブロッキングフィルタアルゴリズムの複雑性と計算時間の問題に対処するために,並列マッピング方式を,デブロッキングフィルタアルゴリズムの並列性とデータの相関を分析することによって提案した。ビデオ符号化の動的プログラマブル再構成可能アレイプロセッサDPRCODEC(DynamicProgrammableReconfigurablearrayprocessor)プラットフォームを用いた。実験結果は,この方法が単一コアプロセッサのシリアル実行方式と比較して,データ負荷時間を30.9倍,アルゴリズム実行と総処理時間を12.3と28.0まで減少させることを示した。Data from Wanfang. Translated by JST【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
著者キーワード (4件):
分類 (3件):
分類
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図形・画像処理一般  ,  専用演算制御装置  ,  符号理論 
タイトルに関連する用語 (3件):
タイトルに関連する用語
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