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J-GLOBAL ID:201802236261837304   整理番号:18A1417130

カバレッジ駆動型設計検証へのSMTソルバーの適用

Applying an SMT Solver to Coverage-Driven Design Verification
著者 (1件):
資料名:
巻: E101.A  号:ページ: 1053-1056(J-STAGE)  発行年: 2018年 
JST資料番号: U0466A  ISSN: 1745-1337  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 英語 (EN)
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ハードウェア設計,特にレジスタ転送レベル(RTL)設計のシミュレーションベースの検証は広く使用されており,設計プロセスの主要なボトルネックの1つである。アプローチの1つは,カバレッジ駆動型検証であり,その目標は,カバレッジと呼ばれるいくつかのメトリックの改善である。従来の研究では,ランダムに生成されたシミュレーションパターンとSAT(充足可能性)ソルバによって生成されたパターンの両方を使用してカバレッジ駆動検証を提案し,その有効性を示した。本論文は,整数,浮動小数点またはビットベクトル変数間の算術的関係を扱うことができるSMT(充足可能性モジュロ理論)ソルバを用いてこのアプローチを拡張した。実験結果は,より多くの算術モジュールが含まれるほど,SMTベースの方法がSATソルバのみを使用する方法より優れていることを示した。(翻訳著者抄録)
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分類 (2件):
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計算理論  ,  計算機シミュレーション 
引用文献 (12件):
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