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J-GLOBAL ID:201802243991523236   整理番号:18A0027458

AES暗号回路の実現電力安定コードに基づくdpa耐性法【Powered by NICT】

Power-stable code based dpa resistant method realizing on AES cryptographic circuit
著者 (5件):
資料名:
巻: 2017  号: EDSSC  ページ: 1-2  発行年: 2017年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,AES暗号回路のためのDPA耐性法に基づく出力安定コードを提案した。出力安定コードを採用して重要な論理回路の漏れ電力消費を安定化した。Addroundkeyの回路は標準AESアルゴリズムのための提案した技術を用いて設計した。設計された回路のリアルタイム電力消費はオシロスコープから記録した。DPA攻撃はMatlabで実行され,電力解析出力安定符号技術は従来のAES回路に現れる微分消費電力波形のピークを効果的に除去する。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All Rights reserved. Translated from English into Japanese by JST【Powered by NICT】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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論理回路  ,  半導体集積回路 
タイトルに関連する用語 (3件):
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