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J-GLOBAL ID：201802244115244873   整理番号：18A1513193

LUT-Lock:FPGA-BitstreamとASICハードウェア保護のための新しいLUTに基づく論理難読【JST・京大機械翻訳】

LUT-Lock: A Novel LUT-Based Logic Obfuscation for FPGA-Bitstream and ASIC-Hardware Protection

著者 (5件)： Mardani Kamali Hadi ,  Zamiri Azar Kimia ,  Gaj Kris ,  Homayoun Houman ,  Sasan Avesta
資料名： IEEE Conference Proceedings  (IEEE Conference Proceedings)
巻： 2018  号： ISVLSI  ページ： 405-410  発行年： 2018年 
JST資料番号： W2441A  資料種別： 会議録 (C)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)

抄録/ポイント： 本研究では,FPGAビットストリームまたはASICネットリストにマッピングされた知的特性を保護するために,新しいLook-Up-TableベースのネットリストのオブフンアルゴリズムであるLUT-Lockを提案した。最初に,SAT攻撃に対してより弾力性のあるLUTベースの難読を作るいくつかの鍵となる特徴の有効性を例証し,次に提案したLUT-Lockアルゴリズムに提案した重要な特徴を埋め込んだ。LUT-Lockは,SATソルバの実行時間における近似的な指数関数的増加を強制的に強制することにより,SAT攻撃に対するLUTに基づくobfuscionの弾力性を最大化することを示した。したがって,LUT-Lockアルゴリズムを採用することによって,SAT攻撃実行時間を,利用されたLUTの数を増やすことによって,不合理に長くすることができた。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】

シソーラス用語： *ハードウェア ,  ASIC ,  *FPGA ,  指数関数 ,  弾性 ,  アルゴリズム ,  近似法
準シソーラス用語： 実行時間 ,  ソルバ ,  ネットリスト ,  ビットストリーム , 【Automatic Indexing@JST】

分類 (1件)： 図形・画像処理一般  (JE04010I)

タイトルに関連する用語 (6件)： LUT ,  FPGA ,  ASIC ,  ハードウェア ,  論理 ,  難読