抄録/ポイント:
抄録/ポイント
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本研究では,広く採用されているハードウェア記述言語を用いて構成できる暗号アルゴリズムの実装のために特別に調整された最初の細粒構成可能なセルアレイを提案した。著者らの解決策は,FPGAの次世代におけるアプリケーション特有の構成可能な構築ブロックとして含まれる小さな,暗号に優しい再構成可能なハードウェアブロックとして加えることができて,正確にDSPスライスと埋め込まれたメモリブロックを,過去に追加した。もう一つのアプリケーションシナリオは,ASIC設計またはマイクロプロセッサに追加されるように見える,小さな埋め込みFPGA(eFPGA)として,我々の構成可能なセルアレイを使用する。これにより,暗号アルゴリズムが,新しく検出された脆弱性または変化する基準に依存して,暗号アルゴリズムをアップグレードまたは更新することを可能にする,いわゆる暗号化の必要性を解決することができる。ブロック暗号に焦点を合わせ,最先端のアルゴリズムをマッピングするための最も適切なセル構造を導出した。Synopsys設計コンパイラの合成能力を利用して,関連する自動設計フローを開発した。著者らは,著者らの新しいセル上に多数のよく知られた暗号をマッピングすることにより,この解の性能を評価した。得られた結果は,提案アーキテクチャが,類似スループットを得ながら,シリコン面積と構成メモリ資源に関して,商用FPGAより劇的に優れていることを示した。Copyright 2018 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】