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J-GLOBAL ID:201802290539797862   整理番号:18A0690127

命令プリフェッチをサポートする2レベル命令キャッシュWCET分析【JST・京大機械翻訳】

Two-level instruction cache WCET analysis with instruction prefetching
著者 (2件):
資料名:
巻: 38  号:ページ: 278-283  発行年: 2017年 
JST資料番号: C3265A  ISSN: 1673-0569  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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組込み式実時間システムにおけるハードウェアの発展に伴い、多くのプロセッサは二段階命令キャッシュを持ち、命令プリフェッチ技術をサポートする。命令プリフェッチ技術は二段階命令キャッシュ構造に広く応用されているかどうかは、二段階命令キャッシュによるサポート命令プリフェッチのキャッシュ最悪ケース実行時間(WCET、Worst-Case Execution Time)が分析されるかどうかに依存する。現在、いくつかのサポート命令プリフェッチによるキャッシュ分析方法が存在しているが、それらはいずれも単層命令キャッシュに用いられており、多層グループの関連命令キャッシュWCET分析に用いることができない。本論文では,2レベル命令キャッシュアーキテクチャにおけるキャッシュ解析のための抽象的意味論を拡張することにより,抽象的解釈に基づくサポート命令プリフェッチのキャッシュWCET解析法を提案した。本論文では,L1命令キャッシュとL2命令キャッシュの遅延と抽象キャッシュの状態に対する命令プリフェッチの影響を分析し,命令のプリフェッチをサポートするL1命令キャッシュとL2命令キャッシュメモリの遅延計算方法とキャッシュ状態分析アルゴリズムを設計した。本論文では、異なるBenchmarksに対して分析を行った結果、本論文のサポート命令プリフェッチのキャッシュWCET解析方法は有効であり、異なる命令プリフェッチ度で、命令プリフェッチは命令プリフェッチのない場合より平均19.3%の性能向上を示した。Data from Wanfang. Translated by JST【JST・京大機械翻訳】
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