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J-GLOBAL ID:201902269225734812   整理番号:19A0512100

VLSIアーキテクチャによる大規模MIMOシステムのためのChebyshev反復に基づく低計算量,高並列性検出法【JST・京大機械翻訳】

Low-Computing-Load, High-Parallelism Detection Method Based on Chebyshev Iteration for Massive MIMO Systems With VLSI Architecture
著者 (5件):
資料名:
巻: 65  号: 14  ページ: 3775-3788  発行年: 2017年 
JST資料番号: C0228A  ISSN: 1053-587X  CODEN: ITPRED  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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最小平均二乗誤差(MMSE)検出は,ユーザとアンテナの両方の数の増加のため,大規模多入力多出力システムのための信号検出においてますます関連している。本論文では,計算負荷を低減し,MMSE検出における主要な問題である行列反転と乗算の可能性のある並列性を探索する並列化Chebyshev反復(PCI)と呼ばれる信号検出法を提案した。最初に,固有値近似に基づく方法を用いて,初期解を得た。次に,最適化Chebyshev反復法を行列反転と乗算の近似計算に適用した。乗算の数はO(BU2+U3)からO(KBU)に減少し,そこではB,U,Kはそれぞれアンテナ,ユーザ,および反復の数である。PCI法は,大規模行列反転および乗算における相関を除去し,それにより,推定ベクトルの要素間の並列性を改善した。これらの改善は,検出精度のわずかな低減のコストで達成される。PCI法に基づいて,128×1664-QAM MMSE検出を実現するために,非常に大規模な統合完全パイプライン化アーキテクチャを提案した。ここでは,反復パラメータを近似計算を通して得て,繰り返し使用し,ユーザレベルパイプライン処理パターンはスループット,面積,および電力の間で最適なトレードオフを達成する。このアーキテクチャをFPGA上で検証し,レイアウトをTSMC65nm1P9M CMOS技術を用いて実装した。現在の最先端の設計と比較して,それぞれ4.56×と3.79×の増加を表す,2.46Gbps/W(スループット/パワー)と0.53Gbps/mm2(スループット/面積)の結果を得た。Copyright 2019 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (2件):
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移動通信  ,  信号理論 
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