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J-GLOBAL ID:202002213760172731   整理番号:20A0332607

組込みハードウェア加速器のための柔軟なデータフローアーキテクチャ【JST・京大機械翻訳】

Flexible Data Flow Architecture for Embedded Hardware Accelerators
著者 (6件):
資料名:
巻: 11944  ページ: 33-47  発行年: 2020年 
JST資料番号: H0078D  ISSN: 0302-9743  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: ドイツ (DEU)  言語: 英語 (EN)
抄録/ポイント:
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制御装置が,高度制御理論,高度信号処理,データベースモデリング,および物理モデリングのような将来のアルゴリズムを実行することを可能にするために,制御装置は計算電力において実質的なステップアップを必要とする。自動車エンジン制御装置(ECU)の場合,安全要件とコスト制約は重要である。マイクロコントローラの性能を向上させる既存の解決策は,期待されるアルゴリズムの部分集合に適していないか,または面積に関してあまりにも高価である。したがって,埋め込まれたハードウェア加速器のための新しいデータフローアーキテクチャ(DFA)を導入した。DFAは,広範囲のデータ集約アルゴリズムに対して,サイズ比当たりの高性能を達成するために,概念レベルから個々の機能ユニットまで柔軟である。ハードウェア実装と比較して,面積は同じ性能で1.4倍高くなった。Copyright Springer Nature Switzerland AG 2020 Translated from English into Japanese by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (4件):
分類
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人工知能  ,  分子・遺伝情報処理  ,  事務管理  ,  ロボットの運動・制御 
タイトルに関連する用語 (5件):
タイトルに関連する用語
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