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J-GLOBAL ID:202002215652338103   整理番号:20A0777701

iotプロセッサ上のARXベースブロック暗号のコンパクトな実装【JST・京大機械翻訳】

Compact Implementations of ARX-Based Block Ciphers on IoT Processors
著者 (4件):
資料名:
巻: 17  号:ページ: 1-16  発行年: 2018年 
JST資料番号: W5694A  ISSN: 1539-9087  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,8ビットAVR,16ビットMSP,32ビットARMおよび32ビットARM-NEONプロセッサを含むIoTデバイス上で,LEAおよびHIGHTを含む付加,回転および排除OR(ARX)ベースのブロック暗号の実装について述べた。LEAとHIGHTブロック暗号に対する32/8ビットごとのARX演算を,単語サイズの変化,汎用レジスタの数,およびターゲットIoTデバイスの命令セットを考慮することにより最適化した。最後に,LEAとHIGHTブロック暗号の最もコンパクトな実装を達成した。実装は,軽量暗号システムフレームワークのFair評価を通して,かなり評価され,そして,実装は,第1および第2ラウンドにおける競争に関して,実行された。Please refer to this article’s citation page on the publisher website for specific rights information. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (2件):
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符号理論  ,  データ保護 
タイトルに関連する用語 (4件):
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