MM-CDRベースADCタイミングスキュー制御と近似乗算器を用いた低電力DSPを用いた10nm FinFETにおける6.4A 56Gb/s 7.7MW/Gb/s PAM-4ワイヤライントランシーバ【JST・京大機械翻訳】

Yoo Byoung-Joo; Lim Dong-Hyuk; Pang Hyonguk; Lee June-Hee; Baek Seung-Yeob; Kim Naxin; Choi Dong-Ho; Choi Young-Ho; Yang Hyeyeon; Yoon Taehun; Chu Sang-Hyeok; Kim Kangjik; Jung Woochul; Kim Bong-Kyu; Lee Jaechol; Kang Gunil; Park Sang-Hune; Choi Michael; Shin Jongshin

文献

J-GLOBAL ID：202002235472238406 整理番号：20A0954595

MM-CDRベースADCタイミングスキュー制御と近似乗算器を用いた低電力DSPを用いた10nm FinFETにおける6.4A 56Gb/s 7.7MW/Gb/s PAM-4ワイヤライントランシーバ【JST・京大機械翻訳】

6.4 A 56Gb/s 7.7mW/Gb/s PAM-4 Wireline Transceiver in 10nm FinFET Using MM-CDR-Based ADC Timing Skew Control and Low-Power DSP with Approximate Multiplier

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著者 (19件)： , , , , , , , , , , , , , , , , , ,
資料名：
巻： 2020 号： ISSCC ページ： 122-124 発行年： 2020年
JST資料番号： W2441A 資料種別：会議録 (C)
記事区分：原著論文発行国：アメリカ合衆国 (USA) 言語：英語 (EN)

I/O帯域幅に対するニーズは,インターネットトラヒックとデータ技術の爆発的成長とともに急速に増加している。要求される高い帯域幅を収容するために,DSPベースのPAM-4送受信機は,チャネル容量[1]-[4]の使用を増加させることにより,最もロバストな解決策になった。しかしながら,チップにおける多くの送受信機と統合するために,低電力設計はDSPベースの送受信機のための重要な因子になっている。本論文は,MM-CDRベースのADCタイミングスキュー制御を提示して,それはADC複雑性と電力を大いに減少させて,近似的乗算器を用いて低電力DSPを大いに減少させた。これに加えて,TXドライバと低電力TX DACのg_mブースティングは全電力消費を低減するのに役立つ。Copyright 2020 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】

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