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J-GLOBAL ID:202002241392931266   整理番号:20A0950651

高レベル合成を用いた爆燃圧縮と減圧のための高スループットFPGAベースハードウェア加速器【JST・京大機械翻訳】

High-Throughput FPGA-Based Hardware Accelerators for Deflate Compression and Decompression Using High-Level Synthesis
著者 (3件):
資料名:
巻:ページ: 62207-62217  発行年: 2020年 
JST資料番号: W2422A  ISSN: 2169-3536  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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Deflate圧縮アルゴリズムは,無損失データ圧縮のために最も広く使われている解の一つを提供する。フィールドプログラマブルゲートアレイ(FPGA)は,計算集中アプリケーションを高速化するハードウェア加速器を実装するために一般的に使用されている。本論文では,Deflate圧縮と減圧のためのFPGAベース加速器について述べた。これらの加速器をC++で特定し,Xilinx Virtex超スケール+直列FPGAのためのVivado高レベル合成(HLS)と250MHzのシステムクロック周波数を用いて合成した。提案した圧縮機は,固定入力スループット4.0Gb/sでデータを処理し,静的Huffman符号化を用いて,Calgaryコーパスベンチマークファイル上で1.92の幾何平均圧縮比を達成した。高レベル合成を用いて合成された最初の圧縮機ではないが,この設計はVivado HLSを用いた他の公表された設計よりも25%大きなスループットと11%の大きな圧縮比を達成した。提案した分解器設計は,静的および動的にコード化されたCalgaryコーパスファイルに対して,それぞれ196.61MB/sおよび97.40MB/sの平均入力スループットを達成した。これは,高レベル合成を用いて合成され,静的スループットが11%高く,動的スループットがXilinxによって販売された専門的に最適化された設計より10%だけ低い性能を提供する最初の発表された減圧設計である。Copyright 2020 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (1件):
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