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J-GLOBAL ID:202002254109823029   整理番号:20A2488006

2つのアプローチを用いたパイプライン構造に適用した完全誤り検出と補正法【JST・京大機械翻訳】

Full Error Detection and Correction Method Applied on Pipelined Structure Using Two Approaches
著者 (6件):
資料名:
巻: 29  号: 13  ページ: 2050218  発行年: 2020年 
JST資料番号: W0526A  ISSN: 0218-1266  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: シンガポール (SGP)  言語: 英語 (EN)
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本論文では,パイプライン構造のための完全誤差検出と補正(FEDC)法を用いて2つのアプローチを評価した。このアプローチを,比較(FDC)による完全重複とパリティ予測(CCPP)による同時チェックと参照した。前述のアプローチを,非指定継続時間のソフトエラーに対処するために,組合せ論理の保護の目的で,2つの方法で誤差検出回路(EDC)を実装するFEDC法の境界ケースに焦点を当てた。FDC手法は,FEDC法の最も複雑で高価な実装として,組合せ回路の完全な重複を実行し,CCPPアプローチは,ソフトエラー検出に対して最も簡単で最も安い技術であるパリティ予測ビットのみを実行する。両手法は組合せ論理におけるソフトエラーを検出することができ,単一故障を設計に注入する。一方,FDCアプローチは,すべての注入故障を検出し,補正するために管理し,一方,CCPPアプローチは,組合せ回路の出力で生成された多重故障を検出することができなかった。他方,FDCアプローチは,CCPPアプローチと比較して,より高い電力消費と面積増加をもたらす。Copyright 2020 World Scientific Publishing Company All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (2件):
分類
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論理回路  ,  固体デバイス計測・試験・信頼性 
タイトルに関連する用語 (3件):
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