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J-GLOBAL ID:202002266270867442   整理番号:20A1633184

FPGAを用いたエッジネットワークにおける侵入検出操作の加速に向けて【JST・京大機械翻訳】

Towards Accelerating Intrusion Detection Operations at the Edge Network using FPGAs
著者 (7件):
資料名:
巻: 2020  号: FMEC  ページ: 104-111  発行年: 2020年 
JST資料番号: W2441A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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本論文では,FPGAを用いてエッジネットワークでの侵入検出操作を加速するための研究を示した。クラウドコンピューティングとネットワーク機能仮想化は,サービス配信と管理のための新しい魅力的パラダイムに導いた。残念ながら,このパラダイムは,より良い通信プラットフォームを追求するIoTアプリケーションとサービスを正しくサポートするのに失敗する。また,サービスとしてのセキュリティは,これらのサービス要求を充足するのに必要なクラウドベースのモデルとして見ることができる。さらに,この文脈で取り組む主な課題の一つは,信頼性が高いまま,膨大な量のデータに対処することができるように,そのようなシステムやサービスの性能を向上させる方法である。ポテンシャル解はFPGAベースエッジコンピューティングであり,エッジと霧の利点と共にFPGA加速能力を提供する強力な組合せである。実際に,本研究は,FORTISEC(40SEC)と呼ばれる侵入防止アーキテクチャを考案することに焦点を当て,それはFPGAモードと同様に完全にソフト化した。従って,著者らは,エッジ上の加速侵入防止の実現に向けて,適切なアルゴリズム,設計原理,および良く定義されたコンポーネントを提示する。また,40SECの実装とその性能試験に利用されるテストベッドを提示した。Copyright 2020 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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分類 (1件):
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図形・画像処理一般 
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