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J-GLOBAL ID:202002299914628553   整理番号:20A1795331

低電力高速精度制御可能な近似乗算器設計【JST・京大機械翻訳】

A low-power high-speed accuracy-controllable approximate multiplier design
著者 (3件):
資料名:
号: ASPDAC ’18  ページ: 605-610  発行年: 2018年 
JST資料番号: D0698C  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: アメリカ合衆国 (USA)  言語: 英語 (EN)
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乗算は,多くのエラー耐性アプリケーションのための重要な基本的機能である。近似的乗算は,性能と精度に対するエネルギー取引のための効率的な技術であると考えられる。本論文では,キャリーマスク加算器により最終製品を生成する精度制御乗算器を提案した。提案した方式は,精度要求を柔軟に満たすために,キャリー伝搬の長さを動的に選択することができた。乗算器の部分積木を,提案した木圧縮機によって近似した。8×8乗算器設計を,キャリーマスク加算器と圧縮機を採用することによって実行した。従来のWallaceツリー乗算器と比較して,提案した乗算器は,必要な精度に依存して,電力消費を47.3%から56.2%,クリティカルパス遅延を29.9%と60.5%の間で削減した。そのシリコン面積は44.6%小さかった。さらに,画像処理応用の結果は,処理画像の品質が提案した乗算器設計によって制御できることを示した。Please refer to this article’s citation page on the publisher website for specific rights information. Translated from English into Japanese by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (2件):
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集積回路一般  ,  論理回路 
タイトルに関連する用語 (4件):
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