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J-GLOBAL ID:202102263052498406   整理番号:21A0754394

折り畳み内挿ADCにおけるデジタルキャリブレーション回路設計【JST・京大機械翻訳】

著者 (1件):
資料名:
号: 13  ページ: 59-61,90  発行年: 2020年 
JST資料番号: C4562A  ISSN: 1006-5059  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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本文では、折り畳み内挿ADCに応用する前台のデジタル予キャリブレーション技術を紹介し、この技術は折り畳み内挿ネットワークに各種の誤差を校正し、ADCの量子化精度を高めることができる。本キャリブレーション回路はすべての実際の過零点と基準点間の誤差を検索し、誤差を校正ステップで符号化し、同時に校正級増幅器を導入し、デジタルコードの代表の誤差を対応するアナログ電流に変換し、回路の不調を校正する。シミュレーションの結果は,この設計回路がゼロ点偏差(0.5LSB以下)を較正し,ADC全体の動的性能SNDRが16.28dB向上し,有効ビットENOBが2.72bit向上し,キャリブレーション効果が顕著であることを示した。Data from Wanfang. Translated by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (1件):
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AD・DA変換回路 
タイトルに関連する用語 (5件):
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