文献
J-GLOBAL ID:202102287969269573
整理番号:21A0326374
余剰コアの活用に向けた実行中プロファイリング手法の検討
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著者 (3件):
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資料名:
巻:
2020
号:
HPC-177
ページ:
Vol.2020-HPC-177,No.7,1-8 (WEB ONLY)
発行年:
2020年12月14日
JST資料番号:
U0451A
資料種別:
会議録 (C)
記事区分:
原著論文
発行国:
日本 (JPN)
言語:
日本語 (JA)
抄録/ポイント:
抄録/ポイント
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近年,CPUの世代が進むに従って,内蔵されるコアの数が増加している.しかし,全てのコアを使って必ずしも最大性能が得られるわけではなく,むしろ性能が低下することもあり,最大の性能が得られる適切なコア数で実行することが重要である.その際に,使われずに余る「余剰コア」の活用を検討している.そのためには,実行時のプロファイルを行いながら,適切な並列度に変更する機能が必要になる.本研究では,実際にSystem Tapを用いた動的なプロファイリングと並列度変更を実現した.実際にNAS Parallel BenchmarksのFTに適用した結果,プロファイルによって得た実行クロック数の値から余剰コアの発生を確認できた.(著者抄録)
シソーラス用語:
シソーラス用語/準シソーラス用語
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分類 (2件):
分類
JSTが定めた文献の分類名称とコードです
ディジタル計算機方式一般
, 計算機システム開発
引用文献 (20件):
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Karl Rupp. Original data up to the year 2010 collected and plotted by m. horowitz, f.labonte, o. shacham, k. olukotun, l. hammond, and c. batten new plot and data collected for 2010-2017. https://www.karlrupp.net/2018/02/42-years-of-microprocessor-trenddata/. Online; accessed 04 July 2020.
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Xeon platinum 8260l - intel - wikichip. https://en.wikichip.org/wiki/intel/xeon_platinum/8260l. Online; accessed 04 July 2020.
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Concezio Bozzi, Sébastien Ponce, and Stefan Roiser. The core software framework for the lhcb upgrade. EPJ Web of Conferences, Vol. 214, p. 05040, 01 2019.
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D. Kim, S. S. Liao, P. H. Wang, J. del Cuvillo, X. Tian, X. Zou, H. Wang, D. Yeung, M. Girkar, and J. P. Shen. Physical experimentation with prefetching helper threads on intel’s hyper-threaded processors. In International Symposium on Code Generation and Optimization, 2004. CGO 2004., pp. 27-38, 2004.
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Benoît Dinechin, Pierre Massas, Guillaume Lager, Clément Léger, Benjamin Orgogozo, Jérôme Reybert, and Thierry Strudel. A distributed run-time environment for the kalray mppa®-256 integrated manycore processor. Procedia Computer Science, Vol. 18, pp. 1654-1663, 12 2013.
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