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J-GLOBAL ID:202202239924247239   整理番号:22A1136864

単入力制御装置における記憶抵抗カオス同期回路の設計と実装を示した。【JST・京大機械翻訳】

Design and Implementation of Memristor-based Chaotic Synchronization under a Single Input Controller
著者 (5件):
資料名:
巻: 44  号:ページ: 400-407  発行年: 2022年 
JST資料番号: C2507A  ISSN: 1009-5896  CODEN: DKXUEC  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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本論文では,単一入力制御器に基づくカオス同期アナログ回路の設計と実現法を提案し,次に,記憶抵抗カオス同期に基づく秘密通信に適用した。第一に,カオス同期化理論に基づいて,カオス同期システムおよび秘密通信モデルを構築し,4次電圧制御のカオス回路およびカオス暗号化復号回路を,設計し,実現した。次に,カオス駆動と応答回路として設計した記憶抵抗カオス回路を用いて,単一入力カオス同期制御装置を,それらの誤差システムに基づいて設計し,そして,それを,記憶抵抗カオス同期回路に実装した。最後に,秘密通信回路を,記憶抵抗のカオス同期に基づいて完成した。実験結果は,設計した記憶抵抗カオス同期回路が単純,便利で,波形が良好で,単一入力制御装置の回路が高速に同期して安定に維持でき,秘密通信実験における信号還元度が高く,損傷程度が小さく,抗解読能力が強いことを示した。それは理論的意味と潜在的実用価値を持つ。Data from Wanfang. Translated by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (3件):
分類
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通信方式一般  ,  計算機網  ,  無線通信一般 
タイトルに関連する用語 (4件):
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