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J-GLOBAL ID：202202263534544736   整理番号：22A0397994

ハイブリッドPSOを用いた65nmにおける2段ミラー補償演算増幅器の面積最適化【JST・京大機械翻訳】

Area Optimisation of Two Stage Miller Compensated Op-Amp in 65 nm Using Hybrid PSO

著者 (2件)： Rashid Ria (School of Electrical Sciences, Indian Institute of Technology Goa, Ponda, India) ,  Nambath Nandakumar (School of Electrical Sciences, Indian Institute of Technology Goa, Ponda, India)
資料名： IEEE Transactions on Circuits and Systems 2: Express Briefs  (IEEE Transactions on Circuits and Systems 2: Express Briefs)
巻： 69  号： 1  ページ： 199-203  発行年： 2022年 
JST資料番号： W0347A  ISSN： 1549-7747  CODEN： ITCSFK  資料種別： 逐次刊行物 (A)
記事区分： 原著論文  発行国： アメリカ合衆国 (USA)  言語： 英語 (EN)

抄録/ポイント： アナログ回路設計は,任意の適切な最適化アルゴリズムを用いて解くことができる非線形制約最適化問題として定式化できる。アナログ回路の設計時間を低減するための異なる最適化技術が報告されている。アナログ回路設計の最適化のための線形減少慣性重量を有するハイブリッドパーティクルスウォーム最適化アルゴリズムを,本研究で提案する。提案方法を用いて,Miller補償による二段操作増幅器回路を設計した。結果は,提案した最適化手法がアナログ回路に必要な設計時間を大幅に削減できることを示した。Copyright 2022 The Institute of Electrical and Electronics Engineers, Inc. All rights reserved. Translated from English into Japanese by JST.【JST・京大機械翻訳】

シソーラス用語： アルゴリズム ,  *最適化 ,  最適化手法 ,  *演算増幅器 ,  線形性 ,  定式化 ,  制約付最適化問題 ,  アナログ回路
準シソーラス用語： 粒子群最適化 ,  アナログ回路設計 , 【Automatic Indexing@JST】

分類 (2件)： AD・DA変換回路  (NC05080M) ,  半導体集積回路  (NC03162T)

タイトルに関連する用語 (6件)： PSO ,  ミラー ,  補償 ,  演算増幅器 ,  面積 ,  最適化