抄録/ポイント:
抄録/ポイント
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近年,VLSIのテストコスト増大に伴い,テストパターン数の削減が重要になっている.テストパターン数を削減するために,テスト圧縮法が提案されている.しかしながら,テスト圧縮法において回路構造が原因となり,多くのテストパターンを削減できない可能性がある.また,テスト圧縮が効果的に適用できるような回路構造に変更するテスト容易化設計手法が提案されている.しかしながら,ゲートレベルでテスト容易化設計を適用すると,遅延の増加により論理合成で実行したタイミングの最適性を損失する可能性がある.論理合成適用前のレジスタ転送レベルでテスト並列化を考慮したテスト容易化設計を適用することが重要である.従来のレジスタ転送レベルでのテスト並列化のためのコントローラ拡大手法は無効状態で状態遷移の設計を行う.そのコントローラ拡大により状態レジスタ数が増加するので,その面積オーバヘッドは大きくなる.本論文では,有効状態における状態遷移が実行されるときに供給される制御信号値のドントケアに着目して,面積オーバヘッドを抑制しながらテストパターン数を削減するための制御信号のドントケア割当て手法を提案する.(著者抄録)