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J-GLOBAL ID:202202292229194198   整理番号:22A1199081

新しい高速低消費電力再構成パイプライン乗算器の設計【JST・京大機械翻訳】

A new design of high?speed and low?power reconfigurable pipeline multiplier
著者 (3件):
資料名:
巻: 30  号:ページ: 131-134  発行年: 2022年 
JST資料番号: C4171A  ISSN: 1674-6236  資料種別: 逐次刊行物 (A)
記事区分: 原著論文  発行国: 中国 (CHN)  言語: 中国語 (ZH)
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現代のデジタル信号処理回路でよく見られる乗算回路は、処理信号の周波数がますます速くなるにつれ、消費電力の大幅な増加を引き起こし、消費電力の増加はエネルギー浪費を招くだけでなく、回路の温度上昇を引き起こし、回路の正常動作に影響を与える。乗算器回路の設計において高速度と低消費電力の目的を考慮し、本文では、入力信号レート自動再構成回路の方法を用いて、新型高速高効率電圧再構成可能パイプライン乗算器回路を設計した。回路シミュレーション結果は,この回路が,1.8GHzの最高周波数で,約60%の電力供給資源を効果的に節約できることを示した。Data from Wanfang. Translated by JST.【JST・京大機械翻訳】
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, 【Automatic Indexing@JST】
分類 (2件):
分類
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演算方式  ,  論理回路 
タイトルに関連する用語 (5件):
タイトルに関連する用語
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