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文献
J-GLOBAL ID:201702227974095251   整理番号:17A0053627

高速入出力インターフェース回路ジッタ耐性試験用のジッタ生成回路の検討

Jitter Generation Circuit for High-Speed I/O Interface Jitter Tolerant Testing
著者 (5件):
荒船拓也
(群馬大 大学院理工学府)
小澤祐喜
(群馬大 大学院理工学府)
塩田良治
(ソシオネクスト)
畠山一実
(群馬大 大学院理工学府)
小林春夫
(群馬大 大学院理工学府)

資料名:
電気学会電子回路研究会資料  (電気学会研究会資料)

巻: ECT-16  号: 82-97.99-109  ページ: 71-76  発行年: 2016年12月14日 
JST資料番号: X0578A  資料種別: 会議録 (C)
記事区分: 原著論文  発行国: 日本 (JPN)  言語: 日本語 (JA)
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