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J-GLOBAL ID：200902286018610976   Reference number：06A0740182

A Virtual-channel Free Routing Strategy for On-chip Torus Networks

オンチップトーラス網における仮想チャネルフリールーティング

Author (3)： MATSUTANI HIROKI (慶応大 大学院理工学研究科) ,  KOIBUCHI MICHIHIRO (国立情報学研) ,  AMANO HIDEHARU (慶応大 大学院理工学研究科)
Material： 情報処理学会論文誌  (IPSJ Journal)
Volume： 47  Issue： SIG12(ACS15)  Page： 12-24  Publication year： Sep. 15, 2006 
JST Material Number： Z0778A  ISSN： 0387-5806  Document type： Article
Article type： 原著論文  Country of issue： Japan (JPN)  Language： JAPANESE (JA)

Thesaurus term： *repeater station ,...
Semi thesaurus term： ハードウェア量 ,...

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JST classification (3)： Computer networks  (JC03000K) ,  Telephone,data communication and exchange in general  (ND11010T) ,  Network methods  (KA03040X)

Reference (19)：

• Benini, L. and Micheli, G. D.: Networks on Chips: A New SoC Paradigm, IEEE Computer, Vol.35, No.1, pp. 70-78(2002).
• Dally, W. J. and Towles, B.: Route Pack ets, Not Wires: On-Chip Interconnection Net works, Proc.38th Design Automation Confer ence, pp. 684-689(2001).
• Anjo, K., Yamada, Y., Koibuchi, M., Jouraku, A. and Amano, H.: BLACK-BUS: A New Data-Transfer Technique using Local Address on Networks-on-Chips, Proc. IEEE Interna tional Parallel and Distributed Processing Sym posium, p. 10a (2004).
• Burger, D., Keckler, S. W., McKinley, K. S., Dahlin, M., John, L. K., Lin, C., Moore, C. R., Burrill, J., McDonald, R. G., Yoder, W. and the TRIPSTeam: Scaling to the End of Silicon with EDGE Architectures, IEEE Computer, Vol.37, No.7, pp. 44-55(2004).
• Hu, J. and Marculescu, R.: Energy and Performance-Aware Mapping for Regular NoC Architectures, IEEE Trans. Computer-Aided Design of Integrated Circuits and Systems, Vol.24, No.4, pp. 551-562(2005).

Terms in the title (2)： 仮想チャネル ,  ルーティング