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J-GLOBAL ID:200903020590090758

メモリ装置とこれを用いたデータ処理システム

Inventor:
Applicant, Patent owner:
Agent (1): 前田 弘 (外2名)
Gazette classification:公開公報
Application number (International application number):1992065659
Publication number (International publication number):1993089668
Application date: Mar. 24, 1992
Publication date: Apr. 09, 1993
Summary:
【要約】【目的】 複数のデータ処理装置によって異なるページが交互にアクセスされる場合でもショートサイクル動作(CASアクセス)を可能にして、メモリ装置の平均アクセス時間及び消費電力を低減させる。【構成】 各々メモリセルアレイ21からの1ページ分のロウデータを蓄えるための複数のデータラッチ回路27,28を設け、各データラッチ回路をデータ処理装置に割り当てる。アドレスは、ロウアドレスRAとカラムアドレスCAとのマルチプレックス形式で与えられる。各データラッチ回路27,28内のデータは、被選択状態でロウアドレスRAが与えられた際に更新される。
Claim (excerpt):
各々複数のロウと複数のカラムとの交点に配置された複数の単位メモリセルを有するメモリセルアレイを備え、かつ該メモリセルアレイのロウとカラムとの指定のためにロウアドレスとカラムアドレスとがマルチプレックス形式で与えられるメモリ装置であって、前記メモリセルアレイからロウアドレスで指定される1つのロウに属する全てのカラムのデータを1ページ分のロウデータとして一度に読み出すためのロウデータ読み出し手段と、各々前記メモリセルアレイから読み出された1ページ分のロウデータを保持するための複数のデータラッチ回路と、データの読み出しが要求されている状態でロウアドレスが与えられた場合には、前記メモリセルアレイから前記ロウデータ読み出し手段により読み出された1ページ分のロウデータを前記複数のデータラッチ回路のうちのラッチ選択信号で指定されたデータラッチ回路に保持させ、データの読み出しが要求されている状態でカラムアドレスが与えられた場合には、前記複数のデータラッチ回路のうちの前記ラッチ選択信号で指定されたデータラッチ回路に保持されている1ページ分のロウデータの中からカラムアドレスで指定される1つのカラムに対応したデータを選択的に読み出しかつ該読み出したデータを出力するための制御手段とを備えたことを特徴とするメモリ装置。
Patent cited by the Patent:
Cited by examiner (3)
  • 特開平1-159891
  • 特開平2-029988
  • 特開昭63-183683

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