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J-GLOBAL ID：200903057305373718

半導体装置

Inventor： 杉町 達也
Applicant, Patent owner： 富士通株式会社
Agent (1)： 井桁 貞一
Gazette classification：公開公報
Application number (International application number)：1992107697
Publication number (International publication number)：1993304251
Application date： Apr. 27, 1992
Publication date： Nov. 16, 1993
Summary：

【要約】 (修正有)【目的】 本発明は、半導体装置に関し、キャパシタ絶縁膜の耐圧劣化を防ぐことができ、しかもキャパシタ絶縁膜全体の厚さを薄くして容量を増加することができる半導体装置を提供することを目的とする。【構成】 キャパシタ下部電極17上にキャパシタ絶縁膜18が形成され、該キャパシタ絶縁膜上にアルミニウム又はその合金からなるキャパシタ上部電極22が形成されてなるキャパシタを有する半導体装置において、該キャパシタ絶縁膜18が少なくとも3層以上の絶縁膜の積層構造19,20,21からなり、該積層構造のうち、中間層20は最上層21に比較してアルミニウムと反応しがたい膜からなり、該最上層21は該中間層20に対してエッチングの選択性を有する膜からなるように構成する。

Claim (excerpt)：

キャパシタ下部電極上にキャパシタ絶縁膜が形成され、該キャパシタ絶縁膜上にアルミニウム又はその合金からなるキャパシタ上部電極が形成されてなるキャパシタを有する半導体装置において、該キャパシタ絶縁膜が少なくとも3層以上の絶縁膜の積層構造からなり、該積層構造のうち、中間層は最上層に比較してアルミニウムと反応しがたい膜からなり、該最上層は該中間層に対してエッチングの選択性を有する膜からなることを特徴とする半導体装置。

IPC (5)：

H01L 27/04 ,  H01L 21/90 ,  H01L 27/108 ,  H01L 21/316 ,  H01L 21/318