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J-GLOBAL ID：200903057805414542

通信制御装置

Inventor： 三戸 純一
Applicant, Patent owner： 三菱電機株式会社
Agent (1)： 高田 守 (外1名)
Gazette classification：公開公報
Application number (International application number)：1991336905
Publication number (International publication number)：1993175999
Application date： Dec. 19, 1991
Publication date： Jul. 13, 1993
Summary：

【要約】【目的】 処理CPUの負荷を軽減し、ソフトウェアによる処理を簡易化すると共に、処理時間の短縮を図る。【構成】 送信の場合には送信RAM12から1回毎の送信フレームを構成するワードを順次読み出す送信制御部11と、受信の場合には1回毎の受信フレームを構成するワードを順次受信RAM22に書き込む受信制御部21と、送信/受信の場合に単位時間毎にフレーム回数分上記動作を繰り返す自動送信タイミング設定部17,18,19,1Aと、各送信/受信フレーム毎の送信RAM12、受信RAM22の先頭アドレス及びワード長を記憶する複数の送信/受信アドレスベースレジスタ15,25、送信/受信データベースレジスタ16,26とを備えている。

Claim (excerpt)：

ホスト制御装置とI/O制御装置を直列通信で接続し、単位時間毎に前記ホスト制御装置から前記I/O制御装置へと、その逆方向に複数のフレームの送受信を行う通信制御装置において、送信の場合には送信RAMから1回毎の送信フレームを構成するワードを順次読み出す第1の手段と、受信の場合には1回毎の受信フレームを構成するワードを順次受信RAMに書き込む第2の手段と、送信/受信の場合に単位時間毎にフレーム回数分上記動作を繰り返す第3の手段と、各送信/受信フレーム毎の送信RAM、受信RAMの先頭アドレス及びワード長を記憶する複数の第4の手段とを備えたことを特徴とする通信制御装置。

IPC (4)：

H04L 13/08 ,  G05B 19/18 ,  G06F 13/00 353 ,  H04L 29/10

Patent cited by the Patent：

Cited by examiner (4)

• 特開昭56-027433
  
• 特開昭63-116541
  
• 特開昭62-221057
  
• 特開昭63-138837